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    A 3.2-GHz 178-fsrms Jitter Subsampling PLL/DLL-Based Injection-Locked Clock Multiplier
    Yoon, D. ; Jung, D. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-07-01), Heft 7, S. 915-925
    Online academicJournal
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    Ultrawideband Power-Switchable Transmitter With 17.7-dBm Output Power for See-Through-Wall Radar
    Liu, M. ; Xiao, J. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 28 (2020-05-01), Heft 5, S. 1331-1335
    Online academicJournal
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    A 175.2-mW 4-Stage OTA With Wide Load Range (400 pF–12 nF) Using Active Parallel Compensation
    Fordjour, S.A. ; Riad, J. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 28 (2020-07-01), Heft 7, S. 1621-1629
    Online academicJournal
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    A 17.5-fJ/bit Energy-Efficient Analog SRAM for Mixed-Signal Processing
    Lee, J. ; Shin, D. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-10-01), Heft 10, S. 2714-2723
    Online academicJournal
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    A 170-dB $\Omega $ CMOS TIA With 52-pA Input-Referred Noise and 1-MHz Bandwidth for Very Low Current Sensing
    Taherzadeh-Sani, M. ; Hussain Hussaini, S.M. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-05-01), Heft 5, S. 1756-1766
    Online academicJournal
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    2009 Index IEEE Transactions on Very Large Scale Integration (VLSI) Systems Vol. 17
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-12-01), Heft 12, S. 1753-1776
    Online academicJournal
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    A 150 mW 8:1 MUX and a 170 mW 1:8 DEMUX for 2.4 gb/s optical-fiber communication systems using n-AlGaAs/i-InGaAs HJFET's
    Fujii, M. ; Numata, K. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 6 (1998-03-01), Heft 1, S. 43-46
    Online academicJournal
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    A 520k (18900, 17010) Array Dispersion LDPC Decoder Architectures for NAND Flash Memory
    Ho, K. ; Chen, C. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-04-01), Heft 4, S. 1293-1293
    Online academicJournal
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    A SUC-Based Full-Binary 6-bit 3.1-GS/s 17.7-mW Current-Steering DAC in 0.038 mm $^{2}$
    Kim, S. ; Kim, M. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-02-01), Heft 2, S. 794-794
    Online academicJournal
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    Exploring Winograd Convolution for Cost-Effective Neural Network Fault Tolerance
    Xue, X. ; Liu, C. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 31 (2023-11-01), Heft 11, S. 1763-1773
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    Layer-Sensitive Neural Processing Architecture for Error-Tolerant Applications
    Li, Z. ; Wang, Q. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 32 (2024-05-01), Heft 5, S. 797-809
    Online academicJournal
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  12. Detailansicht für Treffer 12 öffnen
    Memory-Efficient Multiplier-Less 2-D DWT Design Using Combined Convolution and Lifting Schemes for Wireless Visual Sensors
    Mohanty, B.K.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 32 (2024-04-01), Heft 4, S. 695-703
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    A Multiscale Anisotropic Thermal Model of Chiplet Heterogeneous Integration System
    Wang, C. ; Xu, Q. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 32 (2024), Heft 1, S. 178-189
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    Soft-Error-Aware SRAM With Multinode Upset Tolerance for Aerospace Applications
    Bai, N. ; Xiao, X. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 32 (2024), Heft 1, S. 128-136
    Online academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    Communication-Aware Task Scheduling for Energy-Harvesting Nonvolatile Processors
    Wang, Y. ; Liu, J. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 28 (2020-08-01), Heft 8, S. 1796-1806
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    Design and Analysis of $D$ -Band On-Chip Modulator and Signal Source Based on Split-Ring Resonator
    Liang, Y. ; Boon, C.C. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019-07-01), Heft 7, S. 1513-1526
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    Dummy Faulty Units for Reduced Fail Data Volume From Logic Faults
    Pomeranz, I.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 31 (2023-11-01), Heft 11, S. 1754-1762
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    Fast and Scalable Multicore YOLOv3-Tiny Accelerator Using Input Stationary Systolic Architecture
    Adiono, T. ; Ramadhan, R.M. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 31 (2023-11-01), Heft 11, S. 1774-1787
    Online academicJournal
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    CVA6 RISC-V Virtualization: Architecture, Microarchitecture, and Design Space Exploration
    Sa, B. ; Valente, L. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 31 (2023-11-01), Heft 11, S. 1713-1726
    Online academicJournal
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    An Efficient Training Accelerator for Transformers With Hardware-Algorithm Co-Optimization
    Shao, H. ; Lu, J. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 31 (2023-11-01), Heft 11, S. 1788-1801
    Online academicJournal
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