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    A 28 nm Embedded Split-Gate MONOS (SG-MONOS) Flash Macro for Automotive Achieving 6.4 GB/s Read Throughput by 200 MHz No-Wait Read Operation and 2.0 MB/s Write Throughput at Tj of 170$^{\circ}$ C
    Taito, Y. ; Kono, T. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 51 (2016), Heft 1, S. 213-221
    Online academicJournal
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    A 65 nm 0.5 V DPS CMOS Image Sensor With 17 pJ/Frame.Pixel and 42 dB Dynamic Range for Ultra-Low-Power SoCs
    Couniot, N. ; de Streel, G. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-10-01), Heft 10, S. 2419-2430
    Online academicJournal
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    Design and Test of a 175-Mb/s, Rate-1/2 (128,3,6) Low-Density Parity-Check Convolutional Code Encoder and Decoder
    Swamy, R. ; Bates, S. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 42 (2007-10-01), Heft 10, S. 2245-2256
    Online academicJournal
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    Correction to “A 0.41 pJ/Bit 10 Gb/s Hybrid 2 IIR and 1 Discrete-Time DFE Tap in 28 nm-LP CMOS” [Jul 15 1722-1735]
    Shahramian, S. ; Chan Carusone, A.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-10-01), Heft 10, S. 2463-2463
    Online academicJournal
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    Corrections to “Current-Mode, WCDMA Channel Filter With In-Band Noise Shaping” [Sep 10 1770-1780]
    Pirola, A. ; Liscidini, A. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 46 (2011-02-01), Heft 2, S. 546-546
    Online academicJournal
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    A Compact Broadband Mixed-Signal Power Amplifier in Bulk CMOS With Hybrid Class-G and Dynamic Load Trajectory Manipulation
    Hu, S. ; Kousai, S. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 52 (2017-06-01), Heft 6, S. 1463-1478
    Online academicJournal
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    A 10-Gb/s CMOS CDR and DEMUX IC With a Quarter-Rate Linear Phase Detector
    Byun, S. ; Lee, J.C. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 41 (2006-11-01), Heft 11, S. 2566-2576
    Online academicJournal
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    Analog AGC Circuitry for a CMOS WLAN Receiver
    Jeon, O. ; Fox, R.M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 41 (2006-10-01), Heft 10, S. 2291-2300
    Online academicJournal
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    A low-power 2.4-GHz transmitter/receiver CMOS IC
    Zolfaghari, A. ; Razavi, B.
    In: IEEE Journal of Solid-State Circuits, Jg. 38 (2003-02-01), Heft 2, S. 176-183
    Online academicJournal
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    1310/1550 nm Optical Receivers With Schottky Photodiode in Bulk CMOS
    Diels, W. ; Steyaert, M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-07-01), Heft 7, S. 1776-1784
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    A Handheld High-Sensitivity Micro-NMR CMOS Platform With B-Field Stabilization for Multi-Type Biological/Chemical Assays
    Lei, K. ; Heidari, H. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 52 (2017), Heft 1, S. 284-297
    Online academicJournal
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    A 1 V 103 dB 3rd-Order Audio Continuous-Time $\Delta \Sigma $ ADC With Enhanced Noise Shaping in 65 nm CMOS
    Leow, Y.H. ; Tang, H. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 51 (2016-11-01), Heft 11, S. 2625-2638
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  13. Detailansicht für Treffer 13 öffnen
    A Skew-Free 10 GS/s 6 bit CMOS ADC With Compact Time-Domain Signal Folding and Inherent DEM
    Zhu, S. ; Xu, B. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 51 (2016-08-01), Heft 8, S. 1785-1796
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  14. Detailansicht für Treffer 14 öffnen
    A 0.02 mm$^{2}$ 59.2 dB SFDR 4th-Order SC LPF With 0.5-to-10 MHz Bandwidth Scalability Exploiting a Recycling SC-Buffer Biquad
    Zhao, Y. ; Mak, P. I. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-09-01), Heft 9, S. 1988-2001
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  15. Detailansicht für Treffer 15 öffnen
    A 40 nm CMOS Derivative-Free IF Active-RC BPF With Programmable Bandwidth and Center Frequency Achieving Over 30 dBm IIP3
    Wu, B. ; Chiu, Y.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-08-01), Heft 8, S. 1772-1784
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  16. Detailansicht für Treffer 16 öffnen
    Multigigahertz CMOS dual-modulus prescaler IC
    Cong, H. I. ; Andrews, J.M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 23 (1988-10-01), Heft 5, S. 1189-1194
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    A System Based on Capacitive Interfacing of CMOS With Post-Processed Thin-Film MEMS Resonators Employing Synchronous Readout for Parasitic Nulling
    Huang, L. ; Rieutort-Louis, W. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-04-01), Heft 4, S. 1002-1015
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  18. Detailansicht für Treffer 18 öffnen
    An Energy Efficient Multi-Gbit/s NoC Transceiver Architecture With Combined AC/DC Drivers and Stoppable Clocking in 65 nm and 28 nm CMOS
    Hoppner, S. ; Walter, D. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-03-01), Heft 3, S. 749-762
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    A High-Power and Scalable 2-D Phased Array for Terahertz CMOS Integrated Systems
    Tousi, Y. ; Afshari, E.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-02-01), Heft 2, S. 597-609
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    A 1024-Channel CMOS Microelectrode Array With 26,400 Electrodes for Recording and Stimulation of Electrogenic Cells In Vitro
    Ballini, M. ; Muller, J. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-11-01), Heft 11, S. 2705-2719
    Online academicJournal
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