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    An Efficient High-Throughput Structured-Light Depth Engine
    Bai, Y. ; Jiang, M. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-08-01), Heft 8, S. 1047-1058
    Online academicJournal
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    Low-Latency and Reconfigurable VLSI-Architectures for Computing Eigenvalues and Eigenvectors Using CORDIC-Based Parallel Jacobi Method
    Sharma, R. ; Shrestha, R. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-08-01), Heft 8, S. 1020-1033
    Online academicJournal
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    Power Management Using Test-Pattern Ordering for Wafer-Level Test During Burn-In
    Bahukudumbi, S. ; Chakrabarty, K.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-12-01), Heft 12, S. 1730-1741
    Online academicJournal
    Zugriff:
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    Efficient Synchronization for Embedded On-Chip Multiprocessors
    Monchiero, M. ; Palermo, G. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 14 (2006-10-01), Heft 10, S. 1049-1062
    Online academicJournal
    Zugriff:
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    Highly-Parallel Decoding Architectures for Convolutional Turbo Codes
    He, Z. ; Fortier, P. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 14 (2006-10-01), Heft 10, S. 1147-1151
    Online academicJournal
    Zugriff:
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    Via-Configurable Routing Architectures and Fast Design Mappability Estimation for Regular Fabrics
    Ran, Y. ; Marek-Sadowska, M.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 14 (2006-09-01), Heft 9, S. 998-1009
    Online academicJournal
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    A Lossless Data Compression and Decompression Algorithm and Its Hardware Architecture
    Lin, Ming-Bo ; Lee, Jang-Feng ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 14 (2006-09-01), Heft 9, S. 925-936
    Online academicJournal
    Zugriff:
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    Design Paradigm for Robust Spin-Torque Transfer Magnetic RAM (STT MRAM) From Circuit/Architecture Perspective
    Li, J. ; Ndai, P. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 18 (2010-12-01), Heft 12, S. 1710-1723
    Online academicJournal
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    Volltext
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    A 2.5-GHz Built-in Jitter Measurement System in a Serial-Link Transceiver
    Jiang, S-.Y. ; Cheng, K-.H. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-12-01), Heft 12, S. 1698-1708
    Online academicJournal
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    X-Align: Improving the Scan Cell Observability of Response Compactors
    Sinanoglu, O. ; Almukhaizim, S.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-10-01), Heft 10, S. 1392-1404
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    VLSI Implementation of an Edge-Oriented Image Scaling Processor
    Chen, P. Y. ; Lien, C. Y. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-09-01), Heft 9, S. 1275-1284
    Online academicJournal
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  12. Detailansicht für Treffer 12 öffnen
    Maximizing the Functional Yield of Wafer-to-Wafer 3-D Integration
    Reda, S. ; Smith, G. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-09-01), Heft 9, S. 1357-1362
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    Time-Efficient Single Constant Multiplication Based on Overlapping Digit Patterns
    Thong, J. ; Nicolici, N.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-09-01), Heft 9, S. 1353-1357
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    A New Architecture of a Two-Stage Lossless Data Compression and Decompression Algorithm
    Lin, M. B. ; Chang, Y. Y.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-09-01), Heft 9, S. 1297-1303
    Online academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    Low-Power Snoop Architecture for Synchronized Producer-Consumer Embedded Multiprocessing
    Yu, C. ; Petrov, P.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-09-01), Heft 9, S. 1362-1366
    Online academicJournal
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    CGADL: An Architecture Description Language for Coarse-Grained Reconfigurable Arrays
    Filho, J. O. ; Masekowsky, S. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-09-01), Heft 9, S. 1247-1259
    Online academicJournal
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  17. Detailansicht für Treffer 17 öffnen
    Design and Implementation of a Field Programmable CRC Circuit Architecture
    Toal, C. ; McLaughlin, K. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-08-01), Heft 8, S. 1142-1147
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  18. Detailansicht für Treffer 18 öffnen
    Symbolic Polynomial Maximization Over Convex Sets and Its Application to Memory Requirement Estimation
    Clauss, P. ; Fernandez, F. J. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-08-01), Heft 8, S. 983-996
    Online academicJournal
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    Fast Flip-Chip Pin-Out Designation Respin for Package-Board Codesign
    Lee, R. J. ; Chen, H. M.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-08-01), Heft 8, S. 1087-1098
    Online academicJournal
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    Topology/Floorplan/Pipeline Co-Design of Cascaded Crossbar Bus
    Yoo, J. ; Yoo, S. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-08-01), Heft 8, S. 1034-1047
    Online academicJournal
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    Volltext
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