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  1. Detailansicht für Treffer 1 öffnen
    An effective BIST architecture for power-gating mechanisms in low-power SRAMs
    Bosio, Alberto ; Dilillo, Luigi ; et al.
    In: 2016 17th International Symposium on Quality Electronic Design (ISQED), 2016-03-01, S. 185-191
    Online Konferenz
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    A Comprehensive Investigation of $\text{GaSb}/\text{GaAs}_{0.5}\text{Sb}_{0.5}/\text{GaAs}$ based Double Gate Source-Pocket Engineered Heterogeneous Gate Dielectric Vertical TFET for Optimized Low-Power Applications
    Mahbub, Lamiya ; Masud Badhon, Mehrab Ibne ; et al.
    In: 2024 6th International Conference on Electrical Engineering and Information & Communication Technology (ICEEICT), 2024-05-02, S. 544-549
    Online Konferenz
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    Flexible Low-voltage, Hysteresis-free Ferroelectric Polymer Transistors
    Yu, Yao ; Yao, Yu ; et al.
    In: 2024 Conference of Science and Technology for Integrated Circuits (CSTIC), 2024-03-17, S. 1-3
    Online Konferenz
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  4. Detailansicht für Treffer 4 öffnen
    Design and Implementation of an Arithmetic Unit with Reduced Switching Activity
    V, Uma Maheswari ; C M, Shyamsunder ; et al.
    In: 2023 2nd International Conference on Advancements in Electrical, Electronics, Communication, Computing and Automation (ICAECA), 2023-06-16, S. 1-5
    Online Konferenz
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    Design for efficiency improvement and future prediction in multi chip module for DC-DC converter
    Kawaguchi, Yusuke ; Nakagawa, Akio ; et al.
    In: 2006 37th IEEE Power Electronics Specialists Conference, 2006-06-01, S. 1-6
    Online Konferenz
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  6. Detailansicht für Treffer 6 öffnen
    Enhanced Device Characteristics of InGaAs MOSFETs Using High Switching Speed Ferroelectric Material
    Huang, Ping ; Chen, Mu-Yu ; et al.
    In: 2023 International VLSI Symposium on Technology, Systems and Applications (VLSI-TSA/VLSI-DAT), 2023-04-17, S. 1-2
    Online Konferenz
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    Study of SiC trench MOSFET switching performance
    Yen, Chih-Hung ; Chen, Yu-Ting ; et al.
    In: 2023 International VLSI Symposium on Technology, Systems and Applications (VLSI-TSA/VLSI-DAT), 2023-04-17, S. 1-2
    Online Konferenz
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  8. Detailansicht für Treffer 8 öffnen
    BOMIG: A Majority Logic Synthesis Framework for AQFP Logic
    Fu, Rongliang ; Huang, Junying ; et al.
    In: 2023 Design, Automation & Test in Europe Conference & Exhibition (DATE), 2023-04-01, S. 1-2
    Online Konferenz
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  9. Detailansicht für Treffer 9 öffnen
    Study of Ultra-High Voltage BCD Process with Gate Oxide Thinning
    Liu, Donghua ; Duan, Wenting ; et al.
    In: 2020 China Semiconductor Technology International Conference (CSTIC), 2020-06-26, S. 1-4
    Online Konferenz
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  10. Detailansicht für Treffer 10 öffnen
    A 3mW 6b 4GS/s Subranging ADC with Adaptive Offset-Adjustable Comparators
    Yang, Chung-Ming ; Kuo, Tai-Haur
    In: 2019 IEEE Custom Integrated Circuits Conference (CICC), 2019-04-01, S. 1-4
    Online Konferenz
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  11. Detailansicht für Treffer 11 öffnen
    Design and Characterization of New Content Addressable Memory Cells
    Annovi, Alberto ; Frontini, Luca ; et al.
    In: 2018 IEEE International Symposium on Circuits and Systems (ISCAS), 2018-05-27, S. 1-5
    Online Konferenz
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  12. Detailansicht für Treffer 12 öffnen
    An energy recovery based low loss resonant gate driver circuit for Silicon Carbide MOSFETs
    Sekhar, Jaya Venkata Phani ; Maheshwari, Ramkrishan ; et al.
    In: 2016 IEEE International Conference on Power Electronics, Drives and Energy Systems (PEDES), 2016-12-01, S. 1-5
    Online Konferenz
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  13. Detailansicht für Treffer 13 öffnen
    Dynamic CMOS-rectifying memristor multiplier architecture for power reduction
    Vo, Minh-Huan
    In: 2016 International Conference on IC Design and Technology (ICICDT), 2016-06-01, S. 1-4
    Online Konferenz
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  14. Detailansicht für Treffer 14 öffnen
    A 10-bit 2 MS/s SAR ADC using reverse VCM-based switching scheme
    Fu, Zhongyi ; Tang, Xian ; et al.
    In: 2016 IEEE International Symposium on Circuits and Systems (ISCAS), 2016-05-01, S. 1030-1033
    Online Konferenz
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  15. Detailansicht für Treffer 15 öffnen
    Design of MCML-based LFSR for low power and mixed signal applications
    Agarwal, Samiksha ; Pandey, Neeta ; et al.
    In: 2015 Annual IEEE India Conference (INDICON), 2015-12-01, S. 1-6
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  16. Detailansicht für Treffer 16 öffnen
    Design and optimization of multiple-mesh clock network
    Jung, J. ; Lee, D. ; et al.
    In: 2015 IFIP/IEEE International Conference on Very Large Scale Integration (VLSI-SoC), 2015-10-01, S. 1-6
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  17. Detailansicht für Treffer 17 öffnen
    A 160 nW 25 kS/s 9-bit SAR ADC for neural signal recording applications
    Do, Anh Tuan ; Lam, Chun Kit ; et al.
    In: 10th IEEE International NEWCAS Conference, New Circuits and Systems Conference (NEWCAS), 2012, 2012-06-01, S. 525-528
    Online Konferenz
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  18. Detailansicht für Treffer 18 öffnen
    A power scalable SAR-ADC in 0.18µm-CMOS with 0.5V nano-watt operation
    Sekimoto, Ryota ; Shikata, Akira ; et al.
    In: 2011 1st International Symposium on Access Spaces (ISAS), 2011-06-01, S. 89-94
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  19. Detailansicht für Treffer 19 öffnen
    ASIC Design of an Adaptive Control Unit for Reconfigurable Analog-to-Digital Converters
    Razak, Zulhakimi ; Erdogan, Ahmet ; et al.
    In: 2010 IEEE Computer Society Annual Symposium on VLSI, 2010-07-01, S. 179-184
    Online Konferenz
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