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    Ultrawideband Power-Switchable Transmitter With 17.7-dBm Output Power for See-Through-Wall Radar
    Liu, M. ; Xiao, J. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 28 (2020-05-01), Heft 5, S. 1331-1335
    Online academicJournal
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    A SUC-Based Full-Binary 6-bit 3.1-GS/s 17.7-mW Current-Steering DAC in 0.038 mm $^{2}$
    Kim, S. ; Kim, M. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-02-01), Heft 2, S. 794-794
    Online academicJournal
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    Communication-Aware Task Scheduling for Energy-Harvesting Nonvolatile Processors
    Wang, Y. ; Liu, J. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 28 (2020-08-01), Heft 8, S. 1796-1806
    Online academicJournal
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    Blocker-Tolerant Inductor-Less Harmonic Selection Wideband Receiver Front-End for 5G Applications
    Shams, N. ; Nabki, F.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 31 (2023-03-01), Heft 3, S. 369-381
    Online academicJournal
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    Multitimescale Mitigation for Performance Variability Improvement in Time-Critical Systems
    Lin, J. ; Weckx, P. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-11-01), Heft 11, S. 1757-1769
    Online academicJournal
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    CEVGMM: Computationally Efficient Versatile Generic Memristor Model
    Zafar, M. ; Naeem Awais, M. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-11-01), Heft 11, S. 1794-1802
    Online academicJournal
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    Power-On Reset Circuit in 180-nm CMOS With Brownout Detection, Stable Switching Points, Long Reset Pulse Duration, and Resilience to Switching Noise
    Antonov, A.A. ; Karpovich, M.S. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-10-01), Heft 10, S. 1373-1380
    Online academicJournal
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    A 12-Bit Current-Steering DAC With Unary- Splitting -Binary Segmented Architecture and Improved Decoding Circuit Topology
    Tong, X. ; Liu, D. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-10-01), Heft 10, S. 1391-1400
    Online academicJournal
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  9. Detailansicht für Treffer 9 öffnen
    Power Management for Multicore Processors via Heterogeneous Voltage Regulation and Machine Learning Enabled Adaptation
    Zhan, X. ; Chen, J. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019-11-01), Heft 11, S. 2641-2654
    Online academicJournal
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    A 13.4-MHz Relaxation Oscillator With Temperature Compensation
    Chang, Y. ; Liu, S.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019-07-01), Heft 7, S. 1725-1729
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    Low Phase Noise Ku-Band VCO With Optimal Switched-Capacitor Bank Design
    Mirajkar, P. ; Chand, J. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-03-01), Heft 3, S. 589-593
    Online academicJournal
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  12. Detailansicht für Treffer 12 öffnen
    Time-Domain Arithmetic Logic Unit With Built-In Interconnect
    Aurangozeb, . ; Hossain, A.D. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-10-01), Heft 10, S. 2828-2841
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    Self-Timed Read and Write Operations in STT-MRAM
    Bishnoi, R. ; Oboril, F. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-05-01), Heft 5, S. 1783-1793
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    A Novel Peak Power Supply Noise Measurement and Adaptation System for Integrated Circuits
    Wang, X. ; Zhang, D. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-05-01), Heft 5, S. 1715-1727
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  15. Detailansicht für Treffer 15 öffnen
    Embedded Transition Inversion Coding With Low Switching Activity for Serial Links
    Chiu, C. T. ; Huang, W. C. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 21 (2013-10-01), Heft 10, S. 1797-1810
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  16. Detailansicht für Treffer 16 öffnen
    Design and Implementation of an On-Chip Permutation Network for Multiprocessor System-On-Chip
    Pham, P. H. ; Song, J. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 21 (2013), Heft 1, S. 173-177
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  17. Detailansicht für Treffer 17 öffnen
    Selected Transition Time Adjustment for Tolerating Crosstalk Effects on Network-on-Chip Interconnects
    Zhang, Y. ; Li, H. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 19 (2011-10-01), Heft 10, S. 1787-1800
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  18. Detailansicht für Treffer 18 öffnen
    A Utilitarian Approach to Variation Aware Delay, Power, and Crosstalk Noise Optimization
    Gupta, U. ; Ranganathan, N.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 19 (2011-09-01), Heft 9, S. 1723-1726
    Online academicJournal
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  19. Detailansicht für Treffer 19 öffnen
    A Low-Power Field-Programmable Gate Array Routing Fabric
    Lin, M. ; El Gamal, A.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-10-01), Heft 10, S. 1481-1494
    Online academicJournal
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    Mesh-of-Trees and Alternative Interconnection Networks for Single-Chip Parallelism
    Balkan, A. O. ; Qu, G. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-10-01), Heft 10, S. 1419-1432
    Online academicJournal
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