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    Digital Error Corrector for Phase Lead-Compensated Buck Converter in DVS Applications
    Zhen, S. ; Zhu, X. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 21 (2013-09-01), Heft 9, S. 1747-1751
    Online academicJournal
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    Efficient Synchronization for Embedded On-Chip Multiprocessors
    Monchiero, M. ; Palermo, G. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 14 (2006-10-01), Heft 10, S. 1049-1062
    Online academicJournal
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    Embedded Transition Inversion Coding With Low Switching Activity for Serial Links
    Chiu, C. T. ; Huang, W. C. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 21 (2013-10-01), Heft 10, S. 1797-1810
    Online academicJournal
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    Design and Implementation of an On-Chip Permutation Network for Multiprocessor System-On-Chip
    Pham, P. H. ; Song, J. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 21 (2013), Heft 1, S. 173-177
    Online academicJournal
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    An On-Chip Network Fabric Supporting Coarse-Grained Processor Array
    Pham, P. H. ; Mau, P. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 21 (2013), Heft 1, S. 178-182
    Online academicJournal
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    A High Bit Rate Serial-Serial Multiplier With On-the-Fly Accumulation by Asynchronous Counters
    Meher, M. R. ; Jong, C. C. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 19 (2011-10-01), Heft 10, S. 1733-1745
    Online academicJournal
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    A Fast Built-in Redundancy Analysis for Memories With Optimal Repair Rate Using a Line-Based Search Tree
    Jeong, W. ; Kang, I. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-12-01), Heft 12, S. 1665-1678
    Online academicJournal
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    Internal and External Bitstream Relocation for Partial Dynamic Reconfiguration
    Corbetta, S. ; Morandi, M. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-11-01), Heft 11, S. 1650-1654
    Online academicJournal
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  9. Detailansicht für Treffer 9 öffnen
    Effective Diagnostic Pattern Generation Strategy for Transition-Delay Faults in Full-Scan SOCs
    Appello, D. ; Bernardi, P. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-11-01), Heft 11, S. 1654-1659
    Online academicJournal
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  10. Detailansicht für Treffer 10 öffnen
    A 152-mW Mobile Multimedia SoC With Fully Programmable 3-D Graphics and MPEG4/H.264/JPEG
    Woo, J. H. ; Sohn, J. H. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-09-01), Heft 9, S. 1260-1266
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    Variation-Tolerant Dynamic Power Management at the System-Level
    Chandra, S. ; Lahiri, K. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-09-01), Heft 9, S. 1220-1232
    Online academicJournal
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  12. Detailansicht für Treffer 12 öffnen
    The Design of a Micro Power Management System for Applications Using Photovoltaic Cells With the Maximum Output Power Control
    Shao, H. ; Tsui, C. Y. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-08-01), Heft 8, S. 1138-1142
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    Design and Implementation of a Field Programmable CRC Circuit Architecture
    Toal, C. ; McLaughlin, K. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-08-01), Heft 8, S. 1142-1147
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    IEEE Standard 1500 Compatible Delay Test Framework
    Chen, P. L. ; Lin, J. W. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-08-01), Heft 8, S. 1152-1156
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  15. Detailansicht für Treffer 15 öffnen
    Topology/Floorplan/Pipeline Co-Design of Cascaded Crossbar Bus
    Yoo, J. ; Yoo, S. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-08-01), Heft 8, S. 1034-1047
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  16. Detailansicht für Treffer 16 öffnen
    Constrained Asynchronous Ring Structures for Robust Digital Oscillators
    Hamon, J. ; Fesquet, L. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-07-01), Heft 7, S. 907-919
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  17. Detailansicht für Treffer 17 öffnen
    Design of Network-on-Chip Architectures With a Genetic Algorithm-Based Technique
    Leary, G. ; Srinivasan, K. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-05-01), Heft 5, S. 674-687
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  18. Detailansicht für Treffer 18 öffnen
    Automatic Verification Stimulus Generation for Interface Protocols Modeled With Non-Deterministic Extended FSM
    Shih, C. H. ; Huang, J. D. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-05-01), Heft 5, S. 723-727
    Online academicJournal
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    Integrated Solar Energy Harvesting and Storage
    Guilar, N. J. ; Kleeburg, T. J. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-05-01), Heft 5, S. 627-637
    Online academicJournal
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    Wafer-Level Defect Screening for “Big-D/Small-A” Mixed-Signal SoCs
    Bahukudumbi, S. ; Ozev, S. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-04-01), Heft 4, S. 587-592
    Online academicJournal
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